Difference: 74HC595 (3 vs. 4)

Revision 42021-06-21 - UliRaich

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Le registre à décalage

Introduction

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  • SRCLK: l'horloge pour les données. Sur le flanc montant de SRCLK le bit sur SER est transféré dans le registre à décalage
  • SRCLR: Si le signale est mise à la masse tous les bits du registre à décalage sont effacé
  • RCLK: Sur le flanc montant de RCLK les données dans le registre à décalage sont transféré dans le registre de sortie
Changed:
<
<
  • OE: Si OE est à la masse le contenu du registre de sortie est visible sur les pins e sorti, autrement tous ces pins sont en haute impédance
>
>
  • OE: Si OE est à la masse le contenu du registre de sortie est visible sur les pins en sorti, autrement tous ces pins sont en haute impédance
  74hc595block.png
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